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Genesys创惟与安捷伦共同展示实体层控制晶片来满足不同频宽需求

发布者:管理员 日期:2020-12-16

      Genesys创惟科技于Intel科技论坛中,与安捷伦共同展示该公司支持PCI Express第壹项产品─GL230(GigaCourier™/PHY)──PCI Express实体层控制晶片。

      GL230是目前业界第壹个0.18μm製程的PCIExpressPIPE PHY解决方案。

      GL230除了符合PCI Express Base Specification Revision 1.0a的规范外,同时也符合Intel 所製订的PHY Interface for the PCI Express Architecture version 1.0规格。GL230不仅提供单通道的PCI Express PIPE PHY解决方案,也可扩充致2/4/8/16/32信道,以满足网路、绘图晶片、储存设备等应用的不同频宽需求。

       GL230内含实体层编码译码控製单元(PCS Sub-layer)与搞效能的串行/平行讯号转换器(SERDES)。内建搞效能的锁向回路(PLL),提供稳定的高频讯号来源,使PCI-Express能以高达2.5Gbps的速度(双向5Gbps)无阻碍地正确传送数据,并确保连接的兼容性与稳定性。GL230提供了许多功能,如藉由外部选择Pin之设定,数据输入总线可以设定为8-bit或16-bit之宽度,以因应电路设计上实际需求或应用。而自动极性互换(Polarity Inversion)功能则提供係统业者于係统电路设计上的弹性。GL230同时内建自我检策模式(BIST),藉由反馈回路的自我侦测,可以简便的执行晶片测试功能,而不需昂贵的测量仪器与複杂的测试环境。GL230同时提供了多样的可程序参数,客户可依其个别需求进行修改,以符合不同应用环境的需求。

      依照Genesys创惟科技于本次大会所提出的产品规划,在今年第四季前,0.13μm製程的PCI Express PHY IP也将会开发完成,符合其它晶圆厂的各种製程目前也正在规划中。代号GL231(GigaCourier™/TDM)的PCI Express传输层(Transaction Layer)与数据链路层(Data Link Layer)IP则将于年底完成。 GL231符合Intel PIPE规范,并具备可程序化功能,可完泉支持x1致x16的PIPE PHY。在明年第壹季,Genesys创惟科技也将量产代号GL240(GigaCoureir™/SFO)的PCI Express™ to PCI-X桥接控制晶片(Bridge Controller)。


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